Buffer 9DBV0431AKILF, 4 elementi 137.5MHz max, QFN 32 Pin
- Codice RS:
- 249-4405
- Codice costruttore:
- 9DBV0431AKILF
- Costruttore:
- Renesas Electronics
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Unità | Per unità | Per confezione* |
|---|---|---|
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| 10 - 18 | 2,41 € | 4,82 € |
| 20 - 98 | 2,36 € | 4,72 € |
| 100 - 198 | 2,275 € | 4,55 € |
| 200 + | 2,22 € | 4,44 € |
*prezzo indicativo
- Codice RS:
- 249-4405
- Codice costruttore:
- 9DBV0431AKILF
- Costruttore:
- Renesas Electronics
Specifiche
Documentazione Tecnica
Normative
Dettagli Prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Renesas Electronics | |
| Numero di elementi per chip | 4 | |
| Corrente di alimentazione massima | 4 mA | |
| Frequenza massima in ingresso | 137.5MHz | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | QFN | |
| Numero pin | 32 | |
| Seleziona tutto | ||
|---|---|---|
Marchio Renesas Electronics | ||
Numero di elementi per chip 4 | ||
Corrente di alimentazione massima 4 mA | ||
Frequenza massima in ingresso 137.5MHz | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package QFN | ||
Numero pin 32 | ||
Il modello 9DBV0431 di Renesas Electronics è un buffer a bassissima potenza a 4 uscite per applicazioni PCIe Gen1, Gen2 e Gen3 da 100 MHz. Può essere utilizzato anche per applicazioni Ethernet da 50 M o 125 M tramite la selezione della frequenza del software. Il dispositivo è dotato di 4 attivazioni di uscita per la gestione dell'orologio.
Funzionamento a 1,8 V: consumo energetico minimo
Pin OE#: supporta la gestione dell'alimentazione DIF
Ingresso differenziale compatibile con HCSL: può essere azionato da sorgenti di clock comuni
Uscite di clock differenziali LP-HCSL: riduzione dell'alimentazione e dello spazio sulla scheda
Velocità di scorrimento programmabile per ogni uscita: consente la sintonizzazione per varie lunghezze di linea
Ampiezza di uscita programmabile: consente la sintonizzazione per vari ambienti di applicazione
Larghezza di banda PLL selezionabile tramite pin/software e bypass PLL: riduce al minimo il jitter di fase per ogni applicazione
Uscite bloccate fino a quando PLL non è bloccato: avvio del sistema pulito
Funzionamento PLL software selezionabile a 50 MHz o 125 MHz: utile per le applicazioni Ethernet
La configurazione può essere realizzata con pin di fissaggio: l'interfaccia SMBus non è richiesta per il controllo del dispositivo
L'interfaccia SMBus a 3,3 V tollerante funziona con controller legacy
Pin OE#: supporta la gestione dell'alimentazione DIF
Ingresso differenziale compatibile con HCSL: può essere azionato da sorgenti di clock comuni
Uscite di clock differenziali LP-HCSL: riduzione dell'alimentazione e dello spazio sulla scheda
Velocità di scorrimento programmabile per ogni uscita: consente la sintonizzazione per varie lunghezze di linea
Ampiezza di uscita programmabile: consente la sintonizzazione per vari ambienti di applicazione
Larghezza di banda PLL selezionabile tramite pin/software e bypass PLL: riduce al minimo il jitter di fase per ogni applicazione
Uscite bloccate fino a quando PLL non è bloccato: avvio del sistema pulito
Funzionamento PLL software selezionabile a 50 MHz o 125 MHz: utile per le applicazioni Ethernet
La configurazione può essere realizzata con pin di fissaggio: l'interfaccia SMBus non è richiesta per il controllo del dispositivo
L'interfaccia SMBus a 3,3 V tollerante funziona con controller legacy
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