Decodificatore 74HCT138D,653, SO16 16 Pin
- Codice RS:
- 170-5460P
- Codice costruttore:
- 74HCT138D,653
- Costruttore:
- Nexperia
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Prezzo per 250 unità (fornito in bobina)*
49,75 €
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60,75 €
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Unità | Per unità |
|---|---|
| 250 - 950 | 0,199 € |
| 1000 - 2450 | 0,156 € |
| 2500 + | 0,134 € |
*prezzo indicativo
- Codice RS:
- 170-5460P
- Codice costruttore:
- 74HCT138D,653
- Costruttore:
- Nexperia
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Nexperia | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | SO16 | |
| Numero pin | 16 | |
| Dimensioni | 6.4 x 5.4 x 1.8mm | |
| Tensione di alimentazione operativa massima | 5,5 V | |
| Massima temperatura operativa | +125 °C | |
| Minima temperatura operativa | -40 °C | |
| Tensione di alimentazione operativa minima | 4,5 V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Nexperia | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package SO16 | ||
Numero pin 16 | ||
Dimensioni 6.4 x 5.4 x 1.8mm | ||
Tensione di alimentazione operativa massima 5,5 V | ||
Massima temperatura operativa +125 °C | ||
Minima temperatura operativa -40 °C | ||
Tensione di alimentazione operativa minima 4,5 V | ||
- Paese di origine:
- TH
I modelli 74HC138, 74HCT138 decodificano tre ingressi indirizzo ponderati binari (A0, A1 e A2) su otto uscite reciprocamente esclusive (Y0 a Y7). Il dispositivo è dotato di tre ingressi di abilitazione (E1, E2 ed E3). Ogni uscita sarà ALTA a meno che E1 ed E2 siano basse ed E3 sia ALTA. Questa funzione di abilitazione multipla consente una facile espansione parallela a un 1-di-32 (da 5 a 32 linee) decoder con soli quattro CI '138' e un invertitore. Il modello '138' può essere usato come un demultiplexer a otto uscite utilizzando uno degli ingressi di abilitazione attivo BASSO come l'ingresso dati e gli ingressi di abilitazione rimanenti come luci stroboscopiche.
L'ingresso multiplo consente la facile espansione o controlli indipendenti
Blocco d'ingresso integrato per memorizzare l'indirizzo di linee del decoder
Ideale per la decodifica di selezione di chip di memoria
Opzioni di carico asincrono e sincrono
Opzioni di ingresso con tolleranza alla sovratensione
Configurazione opzionale invertente e non invertente dell'uscita
Uscite a 3 stadi
Alta frequenza
Può essere collegato in cascata
Applicazioni fondamentali
Selezione di banchi di memoria e periferiche
Espansione I/O
Blocco d'ingresso integrato per memorizzare l'indirizzo di linee del decoder
Ideale per la decodifica di selezione di chip di memoria
Opzioni di carico asincrono e sincrono
Opzioni di ingresso con tolleranza alla sovratensione
Configurazione opzionale invertente e non invertente dell'uscita
Uscite a 3 stadi
Alta frequenza
Può essere collegato in cascata
Applicazioni fondamentali
Selezione di banchi di memoria e periferiche
Espansione I/O
