Gate logico Quad OR Texas Instruments, 1,65 V → 3,6 V, 14 Pin, SOIC
- Codice RS:
- 145-5792
- Codice costruttore:
- SN74ALVC32D
- Costruttore:
- Texas Instruments
Non disponibile
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- Codice RS:
- 145-5792
- Codice costruttore:
- SN74ALVC32D
- Costruttore:
- Texas Instruments
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Texas Instruments | |
| Funzione logica | OR | |
| Tipo di montaggio | Montaggio superficiale | |
| Numero di elementi | 4 | |
| Number of Inputs per Gate | 2 | |
| Ingresso trigger di Schmitt | No | |
| Tipo di package | SOIC | |
| Numero pin | 14 | |
| Famiglia logica | ALVC | |
| Tensione di alimentazione operativa massima | 3,6 V | |
| Corrente massima di uscita ad alto livello | -24mA | |
| Ritardo di propagazione massimo @ CL max | 2.8 ns @ 3.3 V, 2.9 ns @ 2.7 V | |
| Tensione di alimentazione operativa minima | 1,65 V | |
| Corrente massima di uscita a basso livello | 24mA | |
| Altezza | 1.58mm | |
| Minima temperatura operativa | -40 °C | |
| Lunghezza | 8.65mm | |
| Massima temperatura operativa | +85 °C | |
| Dimensioni | 8.65 x 3.91 x 1.58mm | |
| Larghezza | 3.91mm | |
| Condizioni di test ritardo di propagazione | 50pF | |
| Seleziona tutto | ||
|---|---|---|
Marchio Texas Instruments | ||
Funzione logica OR | ||
Tipo di montaggio Montaggio superficiale | ||
Numero di elementi 4 | ||
Number of Inputs per Gate 2 | ||
Ingresso trigger di Schmitt No | ||
Tipo di package SOIC | ||
Numero pin 14 | ||
Famiglia logica ALVC | ||
Tensione di alimentazione operativa massima 3,6 V | ||
Corrente massima di uscita ad alto livello -24mA | ||
Ritardo di propagazione massimo @ CL max 2.8 ns @ 3.3 V, 2.9 ns @ 2.7 V | ||
Tensione di alimentazione operativa minima 1,65 V | ||
Corrente massima di uscita a basso livello 24mA | ||
Altezza 1.58mm | ||
Minima temperatura operativa -40 °C | ||
Lunghezza 8.65mm | ||
Massima temperatura operativa +85 °C | ||
Dimensioni 8.65 x 3.91 x 1.58mm | ||
Larghezza 3.91mm | ||
Condizioni di test ritardo di propagazione 50pF | ||
Famiglia 74ALVC, Texas Instruments
Logica CMOS avanzata a bassa tensione
Tensione d'esercizio: 1,65 → 3,6
Compatibilità: Ingresso CMOS, Uscita CMOS
Le prestazioni di latch up superano 250 mA per JESD 17
Tensione d'esercizio: 1,65 → 3,6
Compatibilità: Ingresso CMOS, Uscita CMOS
Le prestazioni di latch up superano 250 mA per JESD 17
Famiglia 74ALVC
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