ISSI SDRAM IS42S32400J-6BLI, 128 MB Montaggio superficiale, BGA 32 bit 90 Pin
- Codice RS:
- 648-081
- Codice costruttore:
- IS42S32400J-6BLI
- Costruttore:
- ISSI
Prezzo per 1 unità*
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- Codice RS:
- 648-081
- Codice costruttore:
- IS42S32400J-6BLI
- Costruttore:
- ISSI
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | ISSI | |
| Tipo prodotto | SDRAM | |
| Dimensione memoria | 128MB | |
| Organizzazione | 1M bit | |
| Larghezza bus dati | 32bit | |
| Larghezza indirizzi bus | 12bit | |
| Frequenza di clock massima | 166MHz | |
| Tempo massimo di accesso casuale | 6ns | |
| Tipo montaggio | Montaggio superficiale | |
| Tipo di package | BGA | |
| Numero pin | 90 | |
| Minima temperatura operativa | -40°C | |
| Temperatura massima di funzionamento | 85°C | |
| Serie | IS42S32400J | |
| Standard/Approvazioni | RoHS | |
| Tensione massima di alimentazione | 3.6V | |
| Standard automobilistico | No | |
| Corrente di alimentazione | 120mA | |
| Tensione minima di alimentazione | 3V | |
| Seleziona tutto | ||
|---|---|---|
Marchio ISSI | ||
Tipo prodotto SDRAM | ||
Dimensione memoria 128MB | ||
Organizzazione 1M bit | ||
Larghezza bus dati 32bit | ||
Larghezza indirizzi bus 12bit | ||
Frequenza di clock massima 166MHz | ||
Tempo massimo di accesso casuale 6ns | ||
Tipo montaggio Montaggio superficiale | ||
Tipo di package BGA | ||
Numero pin 90 | ||
Minima temperatura operativa -40°C | ||
Temperatura massima di funzionamento 85°C | ||
Serie IS42S32400J | ||
Standard/Approvazioni RoHS | ||
Tensione massima di alimentazione 3.6V | ||
Standard automobilistico No | ||
Corrente di alimentazione 120mA | ||
Tensione minima di alimentazione 3V | ||
La SDRAM ISSI 128 Mb è una memoria CMOS ad accesso casuale dinamica ad alta velocità progettata per funzionare in sistemi di memoria VDD da 3,3 V e VDDQ da 3,3 V contenenti 134. 217. 728 bit. Configurato internamente come DRAM quad-bank con un'interfaccia sincrona. Ogni banco di 33. 554. 432 bit è organizzato in 4. 096 righe per 256 colonne per 32 bit. Tutti i segnali sono registrati sul bordo positivo del segnale di clock, CLK. Tutti gli ingressi e le uscite sono compatibili con LVTTL. La SDRAM da 128 MB ha la capacità di eseguire burst dati sincroni ad un'elevata velocità di trasmissione dei dati con la generazione automatica di indirizzi di colonna, la capacità di intercalare tra i banchi interni per nascondere il tempo di ricarica e la capacità di cambiare gli indirizzi di colonna in modo casuale su ogni ciclo di clock durante l'accesso burst.
Aggiornamento automatico (CBR)
Autoaggiornamento
Interfaccia LLVTTL
Indirizzo casuale della colonna per ogni ciclo di clock
