Micron SDRAM MT41K256M16TW-107 IT:P, 4 GB Montaggio superficiale, FBGA 16 bit 96 Pin
- Codice RS:
- 696-909
- Codice costruttore:
- MT41K256M16TW-107 IT:P
- Costruttore:
- Micron
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|---|---|
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*prezzo indicativo
- Codice RS:
- 696-909
- Codice costruttore:
- MT41K256M16TW-107 IT:P
- Costruttore:
- Micron
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Micron | |
| Dimensione memoria | 4GB | |
| Tipo prodotto | SDRAM | |
| Larghezza bus dati | 16bit | |
| Larghezza indirizzi bus | 15bit | |
| Numero bit per parola | 16 | |
| Frequenza di clock massima | 933MHz | |
| Tempo massimo di accesso casuale | 13.91ns | |
| Numero parole | 256 Meg | |
| Tipo montaggio | Montaggio superficiale | |
| Tipo di package | FBGA | |
| Numero pin | 96 | |
| Minima temperatura operativa | -40°C | |
| Temperatura massima di funzionamento | 95°C | |
| Serie | MT41K | |
| Standard/Approvazioni | RoHS | |
| Lunghezza | 14mm | |
| Altezza | 1.2mm | |
| Larghezza | 8mm | |
| Standard automobilistico | No | |
| Corrente di alimentazione | 46mA | |
| Tensione massima di alimentazione | 1.45V | |
| Tensione minima di alimentazione | 1.283V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Micron | ||
Dimensione memoria 4GB | ||
Tipo prodotto SDRAM | ||
Larghezza bus dati 16bit | ||
Larghezza indirizzi bus 15bit | ||
Numero bit per parola 16 | ||
Frequenza di clock massima 933MHz | ||
Tempo massimo di accesso casuale 13.91ns | ||
Numero parole 256 Meg | ||
Tipo montaggio Montaggio superficiale | ||
Tipo di package FBGA | ||
Numero pin 96 | ||
Minima temperatura operativa -40°C | ||
Temperatura massima di funzionamento 95°C | ||
Serie MT41K | ||
Standard/Approvazioni RoHS | ||
Lunghezza 14mm | ||
Altezza 1.2mm | ||
Larghezza 8mm | ||
Standard automobilistico No | ||
Corrente di alimentazione 46mA | ||
Tensione massima di alimentazione 1.45V | ||
Tensione minima di alimentazione 1.283V | ||
- Paese di origine:
- TW
La SDRAM DDR3 di Micron utilizza un'architettura a doppia velocità di trasferimento dati per ottenere un funzionamento ad alta velocità. L'architettura a doppia velocità di trasferimento dati è un'architettura prefetch 8n con un'interfaccia progettata per trasferire due parole di dati per ciclo di clock sui pin I/O. Un'operazione di lettura o scrittura singola per la SDRAM DDR3 consiste effettivamente in un singolo trasferimento dati a 8 n bit e a quattro cicli di orologio sul nucleo DRAM interno e otto trasferimenti dati corrispondenti a n bit e a un ciclo di mezzo orologio sui pin I/O.
Temperatura di auto-rinfrescamento
Auto-rinfrescamento automatico
Registro multiuso
Conformità alla direttiva RoHS