Alliance Memory SDRAM, 2 GB Superficie, FBGA 16 bit 84 Pin
- Codice RS:
- 230-8410P
- Codice costruttore:
- AS4C128M16D2A-25BCN
- Costruttore:
- Alliance Memory
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- Codice RS:
- 230-8410P
- Codice costruttore:
- AS4C128M16D2A-25BCN
- Costruttore:
- Alliance Memory
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Alliance Memory | |
| Dimensione memoria | 2GB | |
| Tipo prodotto | SDRAM | |
| Larghezza bus dati | 16bit | |
| Larghezza indirizzi bus | 13bit | |
| Numero bit per parola | 16 | |
| Frequenza di clock massima | 400MHz | |
| Tempo massimo di accesso casuale | 12.5ns | |
| Tipo montaggio | Superficie | |
| Tipo di package | FBGA | |
| Minima temperatura operativa | 0°C | |
| Numero pin | 84 | |
| Temperatura massima di funzionamento | 85°C | |
| Serie | AS4C128M16D2A | |
| Altezza | 1.2mm | |
| Standard/Approvazioni | RoHS | |
| Lunghezza | 8.1mm | |
| Standard automobilistico | No | |
| Tensione minima di alimentazione | 1.7V | |
| Tensione massima di alimentazione | 1.9V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Alliance Memory | ||
Dimensione memoria 2GB | ||
Tipo prodotto SDRAM | ||
Larghezza bus dati 16bit | ||
Larghezza indirizzi bus 13bit | ||
Numero bit per parola 16 | ||
Frequenza di clock massima 400MHz | ||
Tempo massimo di accesso casuale 12.5ns | ||
Tipo montaggio Superficie | ||
Tipo di package FBGA | ||
Minima temperatura operativa 0°C | ||
Numero pin 84 | ||
Temperatura massima di funzionamento 85°C | ||
Serie AS4C128M16D2A | ||
Altezza 1.2mm | ||
Standard/Approvazioni RoHS | ||
Lunghezza 8.1mm | ||
Standard automobilistico No | ||
Tensione minima di alimentazione 1.7V | ||
Tensione massima di alimentazione 1.9V | ||
Alliance Memory 2Gb DDR2 è una memoria CMOS a doppia velocità di trasferimento dati (DDR2) sincrona dinamica ad accesso casuale (SDRAM) contenente 2048 Mbit in un i/o di dati da 16 bit. È configurato internamente come DRAM a 8 banchi, 8 banchi x indirizzi 16Mb x 16 i/O. Il dispositivo è progettato per essere conforme alle caratteristiche principali DRAM DDR2, come ad esempio il numero CAS postato con latenza additiva, latenza di scrittura = latenza di lettura -1, regolazione dell'impedenza del driver off-chip (OCD) e terminazione di tipo on-die (ODT).
8 banchi interni per il funzionamento simultaneo
architettura di prefetch a 4 bit
Architettura della pipeline interna
Precarica e spegnimento attivo
Registri modalità programmabile e modalità estesa
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