Renesas Electronics Buffer di clock 9DB633AGILF 110 MHz max, TSSOP 28 Pin
- Codice RS:
- 263-7987
- Codice costruttore:
- 9DB633AGILF
- Costruttore:
- Renesas Electronics
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Unità | Per unità | Per Tubo* |
|---|---|---|
| 50 - 50 | 4,45 € | 222,50 € |
| 100 - 200 | 4,027 € | 201,35 € |
| 250 - 450 | 3,925 € | 196,25 € |
| 500 - 950 | 3,822 € | 191,10 € |
| 1000 + | 3,729 € | 186,45 € |
*prezzo indicativo
- Codice RS:
- 263-7987
- Codice costruttore:
- 9DB633AGILF
- Costruttore:
- Renesas Electronics
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Renesas Electronics | |
| Tipo prodotto | Buffer di clock | |
| Frequenza massima in ingresso | 110MHz | |
| Tipo montaggio | Superficie | |
| Tipo di package | TSSOP | |
| Numero pin | 28 | |
| Tensione minima di alimentazione | 3.3V | |
| Tensione massima di alimentazione | 4.6V | |
| Minima temperatura operativa | -40°C | |
| Temperatura massima di funzionamento | 85°C | |
| Serie | 9DB633 | |
| Altezza | 1.2mm | |
| Standard/Approvazioni | RoHS | |
| Lunghezza | 9.8mm | |
| Standard automobilistico | No | |
| Seleziona tutto | ||
|---|---|---|
Marchio Renesas Electronics | ||
Tipo prodotto Buffer di clock | ||
Frequenza massima in ingresso 110MHz | ||
Tipo montaggio Superficie | ||
Tipo di package TSSOP | ||
Numero pin 28 | ||
Tensione minima di alimentazione 3.3V | ||
Tensione massima di alimentazione 4.6V | ||
Minima temperatura operativa -40°C | ||
Temperatura massima di funzionamento 85°C | ||
Serie 9DB633 | ||
Altezza 1.2mm | ||
Standard/Approvazioni RoHS | ||
Lunghezza 9.8mm | ||
Standard automobilistico No | ||
- Paese di origine:
- TW
Il buffer a ritardo zero Renesas Electronics supporta i requisiti di clock PCIe Gen1 e Gen2. È azionato da una coppia di uscita SRC differenziale da un generatore di clock principale IDT. Attenua i jitter sul clock di ingresso ed è dotato di una larghezza di banda PLL selezionabile per massimizzare le prestazioni in sistemi con o senza clock di spettro diffuso.
Interfaccia SMBus
Larghezza di banda PLL selezionabile
Riduce al minimo i picchi di jitter nei PLL a valle
Jitter ciclo-ciclo < 50ps
Deviazione uscita-uscita < 50 ps
Jitter di fase PCIe Gen3 < 1,0 ps RMS
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