Nexperia IC flip flop 74LVC1G79GW,125, 1, 74LVC, CMOS, TSSOP, 5 Pin
- Codice RS:
- 816-8785
- Codice costruttore:
- 74LVC1G79GW,125
- Costruttore:
- Nexperia
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*prezzo indicativo
- Codice RS:
- 816-8785
- Codice costruttore:
- 74LVC1G79GW,125
- Costruttore:
- Nexperia
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Nexperia | |
| Tipo prodotto | IC flip flop | |
| Famiglia logica | 74LVC | |
| Tipo di ingresso | TTL | |
| Tipo uscita | CMOS | |
| Frequenza di clock | 200MHz | |
| Polarità | Invertente | |
| Tipo montaggio | Superficie | |
| Tensione minima di alimentazione | 1.65V | |
| Tipo di package | TSSOP | |
| Numero pin | 5 | |
| Tensione massima di alimentazione | 5.5V | |
| Tipo di attivazione | Fronte positivo | |
| Minima temperatura operativa | -40°C | |
| Ritardo di propagazione massimo @ CL | 5ns | |
| Tipo Flip-Flop | Flip-Flop D | |
| Temperatura massima di funzionamento | 125°C | |
| Numero elementi per chip | 1 | |
| Altezza | 1mm | |
| Lunghezza | 2.25mm | |
| Standard/Approvazioni | No | |
| Larghezza | 1.35 mm | |
| Standard automobilistico | No | |
| Seleziona tutto | ||
|---|---|---|
Marchio Nexperia | ||
Tipo prodotto IC flip flop | ||
Famiglia logica 74LVC | ||
Tipo di ingresso TTL | ||
Tipo uscita CMOS | ||
Frequenza di clock 200MHz | ||
Polarità Invertente | ||
Tipo montaggio Superficie | ||
Tensione minima di alimentazione 1.65V | ||
Tipo di package TSSOP | ||
Numero pin 5 | ||
Tensione massima di alimentazione 5.5V | ||
Tipo di attivazione Fronte positivo | ||
Minima temperatura operativa -40°C | ||
Ritardo di propagazione massimo @ CL 5ns | ||
Tipo Flip-Flop Flip-Flop D | ||
Temperatura massima di funzionamento 125°C | ||
Numero elementi per chip 1 | ||
Altezza 1mm | ||
Lunghezza 2.25mm | ||
Standard/Approvazioni No | ||
Larghezza 1.35 mm | ||
Standard automobilistico No | ||
Flip-flop e latch famiglia 74LVC, Nexperia
Logica CMOS a bassa tensione
Gruppo porta singola
Tensione d'esercizio: da 1,65 a 5,5 V
Compatibilità: Ingresso LVTTL/TTL, Uscita LVCMOS
Famiglia 74LVC
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