Latch tipo D ottale Toshiba 74VHC573FT 8bit bit, Tipo D, TSSOP
- Codice RS:
- 171-3409
- Codice costruttore:
- 74VHC573FT
- Costruttore:
- Toshiba
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*prezzo indicativo
- Codice RS:
- 171-3409
- Codice costruttore:
- 74VHC573FT
- Costruttore:
- Toshiba
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Toshiba | |
| Famiglia logica | 74VHC | |
| Latch Mode | Transparent | |
| Elemento di latching | Tipo D | |
| Numero di bit | 8bit | |
| Numero di elementi per chip | 19 | |
| Numero di canali per chip | 8 | |
| Polarità | Invertente | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | TSSOP | |
| Numero pin | 20 | |
| Dimensioni | 6.5 x 4.4 x 1mm | |
| Altezza | 1mm | |
| Lunghezza | 6.5mm | |
| Tensione di alimentazione operativa massima | 5,5 V | |
| Standard per uso automobilistico | AEC-Q100 | |
| Massima temperatura operativa | +125 °C | |
| Minima temperatura operativa | -40 °C | |
| Larghezza | 4.4mm | |
| Tensione di alimentazione operativa minima | 2 V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Toshiba | ||
Famiglia logica 74VHC | ||
Latch Mode Transparent | ||
Elemento di latching Tipo D | ||
Numero di bit 8bit | ||
Numero di elementi per chip 19 | ||
Numero di canali per chip 8 | ||
Polarità Invertente | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package TSSOP | ||
Numero pin 20 | ||
Dimensioni 6.5 x 4.4 x 1mm | ||
Altezza 1mm | ||
Lunghezza 6.5mm | ||
Tensione di alimentazione operativa massima 5,5 V | ||
Standard per uso automobilistico AEC-Q100 | ||
Massima temperatura operativa +125 °C | ||
Minima temperatura operativa -40 °C | ||
Larghezza 4.4mm | ||
Tensione di alimentazione operativa minima 2 V | ||
Il 74VHC573FT è un LATCH A 8 PORTE CMOS avanzato ad alta velocità con USCITA A 3 STATI fabbricato con tecnologia C2MOS con gate in silicio. Ottiene un funzionamento ad alta velocità simile allequivalente TTL Schottky bipolare, mantenendo al contempo la bassa dissipazione di potenza del CMOS. Questo latch di tipo D a 8 bit è controllato da un ingresso di abilitazione latch (LE) e un ingresso di abilitazione uscita (OE). Quando l'ingresso OE è alto, le otto uscite si trovano in uno stato di impedenza alta. Un circuito di protezione in ingresso assicura lapplicazione di una tensione compresa tra 0 e 5,5 V sui pin di ingresso, indipendentemente dalla tensione di alimentazione. Questo dispositivo può essere utilizzato per interfacciare i sistemi da 5 a 3 V e due sistemi di alimentazione, come i backup per batteria. Questo circuito impedisce la distruzione del dispositivo dovuta alla mancata corrispondenza tra lalimentazione e le tensioni di ingresso
Ampia gamma di temperatura d'esercizio: Topr = da -40 a 125
Alta velocità: fMAX = 180 MHz (tip.) in VCC = 5,0 V
Bassa dissipazione di potenza: ICC = 4 μA (max) a Ta = 25
Elevata immunità al rumore: VNIH = VNIL = 28% VCC (min)
La protezione contro lo spegnimento è prevista su tutti gli ingressi.
Ritardi di propagazione bilanciati: tPLH ≈ tPHL
Ampia gamma di tensione di esercizio: VCC(opr) = da 2 a 5,5 V
Bassa rumorosità: VOLP = 1,0 V (max)
Pin e funzione compatibili con la serie 74
(74AC/HC/AHC/LV ecc.) tipo 573.
Alta velocità: fMAX = 180 MHz (tip.) in VCC = 5,0 V
Bassa dissipazione di potenza: ICC = 4 μA (max) a Ta = 25
Elevata immunità al rumore: VNIH = VNIL = 28% VCC (min)
La protezione contro lo spegnimento è prevista su tutti gli ingressi.
Ritardi di propagazione bilanciati: tPLH ≈ tPHL
Ampia gamma di tensione di esercizio: VCC(opr) = da 2 a 5,5 V
Bassa rumorosità: VOLP = 1,0 V (max)
Pin e funzione compatibili con la serie 74
(74AC/HC/AHC/LV ecc.) tipo 573.
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