Texas Instruments SN74LVC573APWR 8bit bit, Tipo D, 3 stati, TSSOP
- Codice RS:
- 662-9089P
- Codice costruttore:
- SN74LVC573APWR
- Costruttore:
- Texas Instruments
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|---|---|
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- Codice RS:
- 662-9089P
- Codice costruttore:
- SN74LVC573APWR
- Costruttore:
- Texas Instruments
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Texas Instruments | |
| Famiglia logica | LVC | |
| Latch Mode | Transparent | |
| Elemento di latching | Tipo D | |
| Numero di bit | 8bit | |
| Tipo di uscita | 3 stati | |
| Polarità | Non-invertente | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | TSSOP | |
| Numero pin | 20 | |
| Dimensioni | 6.5 x 4.4 x 1.15mm | |
| Altezza | 1.15mm | |
| Lunghezza | 6.5mm | |
| Tensione di alimentazione operativa minima | 1,65 V | |
| Minima temperatura operativa | -40 °C | |
| Massima temperatura operativa | +85 °C | |
| Larghezza | 4.4mm | |
| Tensione di alimentazione operativa massima | 3,6 V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Texas Instruments | ||
Famiglia logica LVC | ||
Latch Mode Transparent | ||
Elemento di latching Tipo D | ||
Numero di bit 8bit | ||
Tipo di uscita 3 stati | ||
Polarità Non-invertente | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package TSSOP | ||
Numero pin 20 | ||
Dimensioni 6.5 x 4.4 x 1.15mm | ||
Altezza 1.15mm | ||
Lunghezza 6.5mm | ||
Tensione di alimentazione operativa minima 1,65 V | ||
Minima temperatura operativa -40 °C | ||
Massima temperatura operativa +85 °C | ||
Larghezza 4.4mm | ||
Tensione di alimentazione operativa massima 3,6 V | ||
Flip-flop e latch famiglia 74LVC, Texas Instruments
Gamma di flip-flop e latch Texas Instruments della famiglia 74LVC di IC logici CMOS a bassa tensione. La famiglia 74LVC utilizza la tecnologia CMOS del gate di silicio ed è progettata per funzionare a 3,3 V, consentendo una notevole riduzione del consumo energetico rispetto ai sistemi da 5 V.
Tensione d'esercizio: 1,65 → 3,6 V
Tolleranza ingresso 5 V
Compatibilità: Ingresso LVTTL/TTL, Uscita LVCMOS
Le prestazioni di latch up superano 250 mA per JESD 17
Protezione ESD superiore a JESD 22
Tolleranza ingresso 5 V
Compatibilità: Ingresso LVTTL/TTL, Uscita LVCMOS
Le prestazioni di latch up superano 250 mA per JESD 17
Protezione ESD superiore a JESD 22
Famiglia 74LVC
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