Intelligent Memory SDRAM AEC-Q100 IM2G16D2DBBG-25I, 2 GB Superficie, FBGA-84 a sfera 16 bit 84 Pin
- Codice RS:
- 588-596
- Codice costruttore:
- IM2G16D2DBBG-25I
- Costruttore:
- Intelligent Memory
Prezzo per 1 unità*
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- Codice RS:
- 588-596
- Codice costruttore:
- IM2G16D2DBBG-25I
- Costruttore:
- Intelligent Memory
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Intelligent Memory | |
| Dimensione memoria | 2GB | |
| Tipo prodotto | SDRAM | |
| Larghezza bus dati | 16bit | |
| Frequenza di clock massima | 533MHz | |
| Tempo massimo di accesso casuale | 2.5ns | |
| Tipo montaggio | Superficie | |
| Tipo di package | FBGA-84 a sfera | |
| Numero pin | 84 | |
| Minima temperatura operativa | -40°C | |
| Temperatura massima di funzionamento | 95°C | |
| Standard/Approvazioni | JEDEC, RoHS | |
| Larghezza | 8mm | |
| Serie | IM2G | |
| Standard automobilistico | AEC-Q100 | |
| Tensione minima di alimentazione | 1.7V | |
| Tensione massima di alimentazione | 1.9V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Intelligent Memory | ||
Dimensione memoria 2GB | ||
Tipo prodotto SDRAM | ||
Larghezza bus dati 16bit | ||
Frequenza di clock massima 533MHz | ||
Tempo massimo di accesso casuale 2.5ns | ||
Tipo montaggio Superficie | ||
Tipo di package FBGA-84 a sfera | ||
Numero pin 84 | ||
Minima temperatura operativa -40°C | ||
Temperatura massima di funzionamento 95°C | ||
Standard/Approvazioni JEDEC, RoHS | ||
Larghezza 8mm | ||
Serie IM2G | ||
Standard automobilistico AEC-Q100 | ||
Tensione minima di alimentazione 1.7V | ||
Tensione massima di alimentazione 1.9V | ||
La DRAM DDR Intelligent Memory raggiunge elevate velocità di trasferimento dati grazie a un'architettura del chip che esegue il prefetching di più bit e sincronizza i dati in uscita con un clock di sistema. Supporta frequenze di sistema fino a 533 MHz, consentendo prestazioni rapide ed efficienti. Comprende banchi interni per il funzionamento simultaneo e utilizza un'architettura di prefetch a 4 bit per aumentare il throughput dei dati.
Conforme alla direttiva RoHS
PASR (self refresh parziale dell'array)
Refresh automatico e self refresh
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