SDRAM AS4C128M16D2A-25BCN, 2Gbit, 400MHz, Da 1,7 V a 1,9 V, FBGA 84 Pin DDR2
- Codice RS:
- 230-8410
- Codice costruttore:
- AS4C128M16D2A-25BCN
- Costruttore:
- Alliance Memory
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- Codice RS:
- 230-8410
- Codice costruttore:
- AS4C128M16D2A-25BCN
- Costruttore:
- Alliance Memory
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Alliance Memory | |
| Dimensioni memoria | 2Gbit | |
| Classe SDRAM | DDR2 | |
| Organizzazione | 128M x 16 | |
| Flusso dati | 400MHz | |
| Larghezza del bus dati | 16bit | |
| Larghezza del bus indirizzi | 13bit | |
| Numero di bit per parola | 16bit | |
| Tempo di accesso casuale massimo | 12.5ns | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | FBGA | |
| Numero pin | 84 | |
| Dimensioni | 8.1 x 12.5 x 1.2mm | |
| Altezza | 1.2mm | |
| Lunghezza | 8.1mm | |
| Massima temperatura operativa | +85 °C | |
| Tensione di alimentazione operativa minima | 1,7 V | |
| Minima temperatura operativa | 0 °C | |
| Tensione di alimentazione operativa massima | 1,9 V | |
| Larghezza | 12.5mm | |
| Seleziona tutto | ||
|---|---|---|
Marchio Alliance Memory | ||
Dimensioni memoria 2Gbit | ||
Classe SDRAM DDR2 | ||
Organizzazione 128M x 16 | ||
Flusso dati 400MHz | ||
Larghezza del bus dati 16bit | ||
Larghezza del bus indirizzi 13bit | ||
Numero di bit per parola 16bit | ||
Tempo di accesso casuale massimo 12.5ns | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package FBGA | ||
Numero pin 84 | ||
Dimensioni 8.1 x 12.5 x 1.2mm | ||
Altezza 1.2mm | ||
Lunghezza 8.1mm | ||
Massima temperatura operativa +85 °C | ||
Tensione di alimentazione operativa minima 1,7 V | ||
Minima temperatura operativa 0 °C | ||
Tensione di alimentazione operativa massima 1,9 V | ||
Larghezza 12.5mm | ||
Alliance Memory 2Gb DDR2 è una memoria CMOS a doppia velocità di trasferimento dati (DDR2) sincrona dinamica ad accesso casuale (SDRAM) contenente 2048 Mbit in un i/o di dati da 16 bit. È configurato internamente come DRAM a 8 banchi, 8 banchi x indirizzi 16Mb x 16 i/O. Il dispositivo è progettato per essere conforme alle caratteristiche principali DRAM DDR2, come ad esempio il numero CAS postato con latenza additiva, latenza di scrittura = latenza di lettura -1, regolazione dell'impedenza del driver off-chip (OCD) e terminazione di tipo on-die (ODT).
8 banchi interni per il funzionamento simultaneo
architettura di prefetch a 4 bit
Architettura della pipeline interna
Precarica e spegnimento attivo
Registri modalità programmabile e modalità estesa
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