Alliance Memory SDRAM AS4C32M16D3L-12BIN, 512 MB Superficie, FBGA 16 bit 96 Pin
- Codice RS:
- 230-8424
- Codice costruttore:
- AS4C32M16D3L-12BIN
- Costruttore:
- Alliance Memory
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Unità | Per unità | Per confezione* |
|---|---|---|
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*prezzo indicativo
- Codice RS:
- 230-8424
- Codice costruttore:
- AS4C32M16D3L-12BIN
- Costruttore:
- Alliance Memory
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Alliance Memory | |
| Dimensione memoria | 512MB | |
| Tipo prodotto | SDRAM | |
| Organizzazione | 32M x 16 | |
| Larghezza bus dati | 16bit | |
| Larghezza indirizzi bus | 12bit | |
| Frequenza di clock massima | 800MHz | |
| Numero bit per parola | 16 | |
| Tempo massimo di accesso casuale | 20ns | |
| Tipo montaggio | Superficie | |
| Tipo di package | FBGA | |
| Minima temperatura operativa | -40°C | |
| Numero pin | 96 | |
| Temperatura massima di funzionamento | 95°C | |
| Altezza | 1mm | |
| Larghezza | 13 mm | |
| Lunghezza | 8mm | |
| Serie | AS4C32M16D3L | |
| Standard/Approvazioni | RoHS | |
| Standard automobilistico | No | |
| Tensione massima di alimentazione | 1.45V | |
| Tensione minima di alimentazione | 1.283V | |
| Seleziona tutto | ||
|---|---|---|
Marchio Alliance Memory | ||
Dimensione memoria 512MB | ||
Tipo prodotto SDRAM | ||
Organizzazione 32M x 16 | ||
Larghezza bus dati 16bit | ||
Larghezza indirizzi bus 12bit | ||
Frequenza di clock massima 800MHz | ||
Numero bit per parola 16 | ||
Tempo massimo di accesso casuale 20ns | ||
Tipo montaggio Superficie | ||
Tipo di package FBGA | ||
Minima temperatura operativa -40°C | ||
Numero pin 96 | ||
Temperatura massima di funzionamento 95°C | ||
Altezza 1mm | ||
Larghezza 13 mm | ||
Lunghezza 8mm | ||
Serie AS4C32M16D3L | ||
Standard/Approvazioni RoHS | ||
Standard automobilistico No | ||
Tensione massima di alimentazione 1.45V | ||
Tensione minima di alimentazione 1.283V | ||
Alliance Memory 512MB Double-Data-Rate-3L (DDR3L) DRAM è un'architettura a doppia velocità di trasferimento dati per ottenere un funzionamento ad alta velocità. È configurato internamente come DRAM a otto banchi.
8 banchi interni per il funzionamento simultaneo
architettura di prefetch 8n-bit
Architettura interna con pipeline
Precarica e spegnimento attivo
Registri modalità programmabile e modalità estesa
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