SDRAM AS4C8M16SA-7TCNTR, 128Mbit, 166MHz, 3 V → 3,6 V, TSOP 54 Pin DDR
- RS Stock No.:
- 230-8443
- Mfr. Part No.:
- AS4C8M16SA-7TCNTR
- Brand:
- Alliance Memory
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- RS Stock No.:
- 230-8443
- Mfr. Part No.:
- AS4C8M16SA-7TCNTR
- Brand:
- Alliance Memory
Specifications
Technical Reference
Legislation and Compliance
Product Details
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Select all | Attribute | Value |
|---|---|---|
| Marchio | Alliance Memory | |
| Dimensioni memoria | 128Mbit | |
| Organizzazione | 8 M x 16 | |
| Classe SDRAM | DDR | |
| Flusso dati | 166MHz | |
| Larghezza del bus dati | 16bit | |
| Larghezza del bus indirizzi | 121bit | |
| Numero di bit per parola | 16bit | |
| Tempo di accesso casuale massimo | 5.4ns | |
| Numero di parole | 8 M | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | TSOP | |
| Numero pin | 54 | |
| Dimensioni | 22.35 x 10.29 x 1.2mm | |
| Altezza | 1.2mm | |
| Lunghezza | 22.35mm | |
| Massima temperatura operativa | +70 °C | |
| Tensione di alimentazione operativa minima | 3 V | |
| Tensione di alimentazione operativa massima | 3,6 V | |
| Minima temperatura operativa | 0 °C | |
| Larghezza | 10.29mm | |
| Select all | ||
|---|---|---|
Marchio Alliance Memory | ||
Dimensioni memoria 128Mbit | ||
Organizzazione 8 M x 16 | ||
Classe SDRAM DDR | ||
Flusso dati 166MHz | ||
Larghezza del bus dati 16bit | ||
Larghezza del bus indirizzi 121bit | ||
Numero di bit per parola 16bit | ||
Tempo di accesso casuale massimo 5.4ns | ||
Numero di parole 8 M | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package TSOP | ||
Numero pin 54 | ||
Dimensioni 22.35 x 10.29 x 1.2mm | ||
Altezza 1.2mm | ||
Lunghezza 22.35mm | ||
Massima temperatura operativa +70 °C | ||
Tensione di alimentazione operativa minima 3 V | ||
Tensione di alimentazione operativa massima 3,6 V | ||
Minima temperatura operativa 0 °C | ||
Larghezza 10.29mm | ||
La SDRAM 128MB Alliance Memory è una DRAM sincrona CMOS ad alta velocità contenente 128 Mbit. È configurato internamente come 4 banchi di 2M word x 16 DRAM con interfaccia sincrona (tutti i segnali sono registrati sul fronte positivo del segnale di clock, CLK). Gli accessi in lettura e scrittura alla SDRAM sono orientati al burst
gli accessi partono da una posizione selezionata e continuano per un numero programmato di posizioni in una sequenza programmata. Gli accessi iniziano con la registrazione di un comando BankActivate seguito da un comando Read o Write.
Aggiornamento automatico e aggiornamento automatico
4096 cicli di aggiornamento/64ms
Modalità di spegnimento CKE
Alimentatore singolo da +3,3 V 0,3 V.
Interfaccia: LVTTL
4096 cicli di aggiornamento/64ms
Modalità di spegnimento CKE
Alimentatore singolo da +3,3 V 0,3 V.
Interfaccia: LVTTL
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