Renesas Electronics Buffer differenziale PCIe 9DB102BGLF 101 MHz max, TSSOP 20 Pin
- Codice RS:
- 254-4987
- Codice costruttore:
- 9DB102BGLF
- Costruttore:
- Renesas Electronics
Informazioni sulle scorte attualmente non disponibili
- Codice RS:
- 254-4987
- Codice costruttore:
- 9DB102BGLF
- Costruttore:
- Renesas Electronics
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Renesas Electronics | |
| Tipo prodotto | Buffer differenziale PCIe | |
| Frequenza massima in ingresso | 101MHz | |
| Tipo montaggio | Superficie | |
| Ritardo di propagazione massimo | 4.2ns | |
| Tipo di package | TSSOP | |
| Numero pin | 20 | |
| Tensione minima di alimentazione | 2.7V | |
| Tensione massima di alimentazione | 5.5V | |
| Minima temperatura operativa | -40°C | |
| Temperatura massima di funzionamento | 85°C | |
| Lunghezza | 8.75mm | |
| Altezza | 1.75mm | |
| Standard/Approvazioni | RoHS | |
| Serie | ICS9DB102 | |
| Standard automobilistico | No | |
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|---|---|---|
Marchio Renesas Electronics | ||
Tipo prodotto Buffer differenziale PCIe | ||
Frequenza massima in ingresso 101MHz | ||
Tipo montaggio Superficie | ||
Ritardo di propagazione massimo 4.2ns | ||
Tipo di package TSSOP | ||
Numero pin 20 | ||
Tensione minima di alimentazione 2.7V | ||
Tensione massima di alimentazione 5.5V | ||
Minima temperatura operativa -40°C | ||
Temperatura massima di funzionamento 85°C | ||
Lunghezza 8.75mm | ||
Altezza 1.75mm | ||
Standard/Approvazioni RoHS | ||
Serie ICS9DB102 | ||
Standard automobilistico No | ||
Il buffer a ritardo zero Renesas Electronics supporta i requisiti di clock PCI express. è azionato da una coppia di uscita SRC differenziale da un clock principale conforme a ICS CK410/CK505. Attenua i jitter sul clock di ingresso e ha una larghezza di banda PLL selezionabile per massimizzare le prestazioni in sistemi con o senza clock di spettro diffuso.
Pin CLKREQ per uscite 1 e 4/attivazione uscita per applicazioni di scheda express PLL o modalità bypass/PLL può attivare il clock in ingresso Larghezza di banda PLL selezionabile/minimizza i jitter di picco in downstream PLL Compatibile con lo spettro diffuso/traccia il clock di ingresso diffuso per interfaccia SMBus a bassa EMI/le uscite inutilizzate possono essere disabilitate, disponibile la gamma di temperature industriali
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