Microprocessore STMicroelectronics STM32MP233DAJ3, ARM Cortex A35, ARM Cortex M33 ARM V8-M, 64 bit, ARM Cortex, 16 bit,
- Codice RS:
- 482-989
- Codice costruttore:
- STM32MP233DAJ3
- Costruttore:
- STMicroelectronics
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- STM32MP233DAJ3
- Costruttore:
- STMicroelectronics
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | STMicroelectronics | |
| Tipo prodotto | Microprocessore | |
| Serie | STM32MP23xA/D | |
| Core del dispositivo | ARM Cortex A35, ARM Cortex M33 | |
| Larghezza bus dati | 16bit | |
| Instruction Set Architecture | ARM V8-M, 64 bit, ARM Cortex | |
| Frequenza di clock massima | 1.5GHz | |
| Tipo di interfaccia | USB 2.0, UART, SDM, USART, SPI, CAN, I3C, CSI, DDR4, LPDDR4, FMC, Parallelo, I2C, NAND, DDR3L, DSI, LVDS, Ethernet, MIPI | |
| Tipo di package | TFBGA361 | |
| Tensione minima di alimentazione | 1.71V | |
| Numero pin | 361 | |
| Tensione massima di alimentazione | 3.6V | |
| Standard/Approvazioni | JEDEC, ECOPACK2 | |
| Numero processori | 2 | |
| Standard automobilistico | No | |
| Seleziona tutto | ||
|---|---|---|
Marchio STMicroelectronics | ||
Tipo prodotto Microprocessore | ||
Serie STM32MP23xA/D | ||
Core del dispositivo ARM Cortex A35, ARM Cortex M33 | ||
Larghezza bus dati 16bit | ||
Instruction Set Architecture ARM V8-M, 64 bit, ARM Cortex | ||
Frequenza di clock massima 1.5GHz | ||
Tipo di interfaccia USB 2.0, UART, SDM, USART, SPI, CAN, I3C, CSI, DDR4, LPDDR4, FMC, Parallelo, I2C, NAND, DDR3L, DSI, LVDS, Ethernet, MIPI | ||
Tipo di package TFBGA361 | ||
Tensione minima di alimentazione 1.71V | ||
Numero pin 361 | ||
Tensione massima di alimentazione 3.6V | ||
Standard/Approvazioni JEDEC, ECOPACK2 | ||
Numero processori 2 | ||
Standard automobilistico No | ||
- Paese di origine:
- TW
I dispositivi MPU con doppio Arm Cortex-A35 di STMicroelectronics si basano sul core RISC ad alte prestazioni Arm Cortex-A35 a 64 bit, singolo o doppio, che funziona fino a 1,5 GHz. Il processore Cortex-A35 comprende una cache istruzioni L1 da 32 Kbyte per ogni CPU, una cache dati L1 da 32 Kbyte per ogni CPU e una cache L2 da 512 Kbyte. Il processore Cortex-A35 utilizza una pipeline in-order a 8 stadi altamente efficiente che è stata ampiamente ottimizzata per fornire tutte le funzionalità Armv8-A massimizzando l'area e l'efficienza energetica.
Sensori di temperatura interni
Basso consumo energetico
Gestione dell'orologio
Interfaccia parallela digitale fino a 16 bit di ingresso o uscita
Due interfacce di memoria Octo-SPI
Conservazione della memoria DDR in modalità Standby
Controlli per il chip abbinato PMIC
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