Microprocessore Microchip ATSAMA5D27C-D1G-CU, ARM Cortex A5, 32bit, 500MHz, LFBGA 289 Pin
- Codice RS:
- 165-6445
- Codice costruttore:
- ATSAMA5D27C-D1G-CU
- Costruttore:
- Microchip
Al momento non disponibile
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- Codice RS:
- 165-6445
- Codice costruttore:
- ATSAMA5D27C-D1G-CU
- Costruttore:
- Microchip
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Microchip | |
| Famiglia | SAMA5D2 | |
| Core del dispositivo | ARM Cortex A5 | |
| Larghezza del bus dati | 32bit | |
| Instruction Set Architecture | ARM | |
| Frequenza massima | 500MHz | |
| Tensione di I/O | 1.65 → 3.6V | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di package | LFBGA | |
| Numero pin | 289 | |
| Tensione di alimentazione operativa tipica | 1,2 V, 1,35 V, 1,5 V, 1,8 V, 3,3 V | |
| Dimensioni | 14 x 14 x 1.03mm | |
| Minima temperatura operativa | -40 °C | |
| Massima temperatura operativa | +85 °C | |
| Seleziona tutto | ||
|---|---|---|
Marchio Microchip | ||
Famiglia SAMA5D2 | ||
Core del dispositivo ARM Cortex A5 | ||
Larghezza del bus dati 32bit | ||
Instruction Set Architecture ARM | ||
Frequenza massima 500MHz | ||
Tensione di I/O 1.65 → 3.6V | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di package LFBGA | ||
Numero pin 289 | ||
Tensione di alimentazione operativa tipica 1,2 V, 1,35 V, 1,5 V, 1,8 V, 3,3 V | ||
Dimensioni 14 x 14 x 1.03mm | ||
Minima temperatura operativa -40 °C | ||
Massima temperatura operativa +85 °C | ||
Il System-in-Package (SiP) SAMA5D27C-D1G integra lMPU SAMA5D27C basato su processore ARM® Cortex®-A5 con 1 Gbit (128 MB) di SDRAM DDR2 in un singolo contenitore. Combinando il SAMA5D2 ad elevate prestazioni e bassa potenza con la SDRAM DDR2 in un singolo contenitore, nella maggior parte dei casi si riducono la complessità d'istradamento del circuito stampato, l'area e il numero di strati. Ciò rende più facile e più robusta la progettazione della scheda per EMI, ESD e lintegrità del segnale. Questo SiP è pensato per le applicazioni con sistema operativo Linux ed è disponibile in un contenitore BGA289.
Core ARM Cortex-A5
Architettura della memoria
Unità di gestione della memoria
Cache dati da 32 Kbyte L1, cache istruzioni da 32 Kbyte L1
La cache configurabile da 128 Kbyte L2 può essere utilizzata come una SRAM interna
1 GB di SDRAM DDR2
Una SRAM interna da 128 Kbyte
Controller NAND SLC/MLC a 8 bit, con codice di correzione degli errori (PMECC) fino a 32 bit
Modalità a bassa potenza
Modalità a bassissima potenza con capacità di attivazione rapida
Architettura della memoria
Unità di gestione della memoria
Cache dati da 32 Kbyte L1, cache istruzioni da 32 Kbyte L1
La cache configurabile da 128 Kbyte L2 può essere utilizzata come una SRAM interna
1 GB di SDRAM DDR2
Una SRAM interna da 128 Kbyte
Controller NAND SLC/MLC a 8 bit, con codice di correzione degli errori (PMECC) fino a 32 bit
Modalità a bassa potenza
Modalità a bassissima potenza con capacità di attivazione rapida
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