Renesas Electronics Buffer di clock 9DB106BGLF 105 MHz max, TSSOP 28 Pin
- Codice RS:
- 263-7981
- Codice costruttore:
- 9DB106BGLF
- Costruttore:
- Renesas Electronics
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Prezzo per 1 confezione da 2 unità*
8,88 €
(IVA esclusa)
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Unità | Per unità | Per confezione* |
|---|---|---|
| 2 - 8 | 4,44 € | 8,88 € |
| 10 - 18 | 3,975 € | 7,95 € |
| 20 - 48 | 3,895 € | 7,79 € |
| 50 - 98 | 3,765 € | 7,53 € |
| 100 + | 3,265 € | 6,53 € |
*prezzo indicativo
- Codice RS:
- 263-7981
- Codice costruttore:
- 9DB106BGLF
- Costruttore:
- Renesas Electronics
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Renesas Electronics | |
| Tipo prodotto | Buffer di clock | |
| Frequenza massima in ingresso | 105MHz | |
| Ritardo di propagazione massimo | 150ps | |
| Tipo montaggio | Superficie | |
| Tipo di package | TSSOP | |
| Numero pin | 28 | |
| Tensione minima di alimentazione | 2.7V | |
| Tensione massima di alimentazione | 4.6V | |
| Minima temperatura operativa | -40°C | |
| Temperatura massima di funzionamento | 85°C | |
| Altezza | 1mm | |
| Standard/Approvazioni | RoHS | |
| Serie | 9DB106 REV L | |
| Lunghezza | 9.7mm | |
| Standard automobilistico | No | |
| Seleziona tutto | ||
|---|---|---|
Marchio Renesas Electronics | ||
Tipo prodotto Buffer di clock | ||
Frequenza massima in ingresso 105MHz | ||
Ritardo di propagazione massimo 150ps | ||
Tipo montaggio Superficie | ||
Tipo di package TSSOP | ||
Numero pin 28 | ||
Tensione minima di alimentazione 2.7V | ||
Tensione massima di alimentazione 4.6V | ||
Minima temperatura operativa -40°C | ||
Temperatura massima di funzionamento 85°C | ||
Altezza 1mm | ||
Standard/Approvazioni RoHS | ||
Serie 9DB106 REV L | ||
Lunghezza 9.7mm | ||
Standard automobilistico No | ||
- Paese di origine:
- TW
Il buffer a ritardo zero Renesas Electronics supporta i requisiti di clock PCIe Gen1 e Gen2. È azionato da una coppia di uscita SRC differenziale da un generatore di clock principale IDT. Attenua i jitter sul clock di ingresso ed è dotato di una larghezza di banda PLL selezionabile per massimizzare le prestazioni in sistemi con o senza clock di spettro diffuso.
Interfaccia SMBus
Jitter ciclo-ciclo < 50ps
Deviazione uscita-uscita < 50 ps
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