Infineon Buffer di clock CY2305SXI-1H 133 MHz max, SOIC 8 Pin
- Codice RS:
- 273-7328
- Codice costruttore:
- CY2305SXI-1H
- Costruttore:
- Infineon
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Unità | Per unità | Per Tubo* |
|---|---|---|
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*prezzo indicativo
- Codice RS:
- 273-7328
- Codice costruttore:
- CY2305SXI-1H
- Costruttore:
- Infineon
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Infineon | |
| Tipo prodotto | Buffer di clock | |
| Frequenza massima in ingresso | 133MHz | |
| Tipo montaggio | Superficie | |
| Ritardo di propagazione massimo | 8.7ns | |
| Tipo di package | SOIC | |
| Numero pin | 8 | |
| Numero di uscite | 8 | |
| Tensione minima di alimentazione | 3V | |
| Tensione massima di alimentazione | 3.6V | |
| Minima temperatura operativa | 0°C | |
| Temperatura massima di funzionamento | 70°C | |
| Larghezza | 4.8 mm | |
| Altezza | 1.5mm | |
| Lunghezza | 5.84mm | |
| Serie | CY2305 | |
| Standard/Approvazioni | No | |
| Standard automobilistico | No | |
| Seleziona tutto | ||
|---|---|---|
Marchio Infineon | ||
Tipo prodotto Buffer di clock | ||
Frequenza massima in ingresso 133MHz | ||
Tipo montaggio Superficie | ||
Ritardo di propagazione massimo 8.7ns | ||
Tipo di package SOIC | ||
Numero pin 8 | ||
Numero di uscite 8 | ||
Tensione minima di alimentazione 3V | ||
Tensione massima di alimentazione 3.6V | ||
Minima temperatura operativa 0°C | ||
Temperatura massima di funzionamento 70°C | ||
Larghezza 4.8 mm | ||
Altezza 1.5mm | ||
Lunghezza 5.84mm | ||
Serie CY2305 | ||
Standard/Approvazioni No | ||
Standard automobilistico No | ||
Il buffer di ritardo zero Infineon è progettato per distribuire orologi ad alta velocità. Utilizza un ingresso di riferimento e distribuisce cinque clock a basso skew. Tutte le parti sono dotate di PLL su chip che si bloccano a un clock di ingresso sul pin REF. Il feedback del PLL è su chip e si ottiene dal pad CLKOUT. Questi dispositivi buffer possono accettare lo stesso clock di ingresso e distribuirlo. In questo caso, la deviazione tra le uscite di due dispositivi è garantita inferiore a 700 ps.
60 ps ciclo-ciclo jitter tipico
Ritardo di propagazione ingresso/uscita pari a zero
Modalità di test per bypassare l'anello bloccato in fase
Compatibile con i sistemi basati su Pentium
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