Memoria Flash Cypress Semiconductor, 16Mbit, TSOP, 48 Pin, CFI
- Codice RS:
- 193-8786
- Codice costruttore:
- S29AL016J70TFI013
- Costruttore:
- Infineon
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- Codice RS:
- 193-8786
- Codice costruttore:
- S29AL016J70TFI013
- Costruttore:
- Infineon
Specifiche
Documentazione Tecnica
Normative
Dettagli prodotto
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Seleziona tutto | Attributo | Valore |
|---|---|---|
| Marchio | Infineon | |
| Dimensioni memoria | 16Mbit | |
| Interfacce | CFI | |
| Tipo di package | TSOP | |
| Numero pin | 48 | |
| Organizzazione | 2M x 8 bit | |
| Tipo di montaggio | Montaggio superficiale | |
| Tipo di cella | NOR | |
| Tensione di alimentazione operativa minima | 2,7 V | |
| Tensione di alimentazione operativa massima | 3,6 V | |
| Organizzazione a blocchi | Asimmetrico | |
| Lunghezza | 12mm | |
| Altezza | 1.05mm | |
| Larghezza | 18.4mm | |
| Dimensioni | 18.4 x 12 x 1.05mm | |
| Numero di parole | 2M | |
| Minima temperatura operativa | -40 °C | |
| Numero di bit per parola | 8bit | |
| Massima temperatura operativa | +85 °C | |
| Standard per uso automobilistico | AEC-Q100 | |
| Tempo di accesso casuale massimo | 70ns | |
| Serie | S29AL | |
| Seleziona tutto | ||
|---|---|---|
Marchio Infineon | ||
Dimensioni memoria 16Mbit | ||
Interfacce CFI | ||
Tipo di package TSOP | ||
Numero pin 48 | ||
Organizzazione 2M x 8 bit | ||
Tipo di montaggio Montaggio superficiale | ||
Tipo di cella NOR | ||
Tensione di alimentazione operativa minima 2,7 V | ||
Tensione di alimentazione operativa massima 3,6 V | ||
Organizzazione a blocchi Asimmetrico | ||
Lunghezza 12mm | ||
Altezza 1.05mm | ||
Larghezza 18.4mm | ||
Dimensioni 18.4 x 12 x 1.05mm | ||
Numero di parole 2M | ||
Minima temperatura operativa -40 °C | ||
Numero di bit per parola 8bit | ||
Massima temperatura operativa +85 °C | ||
Standard per uso automobilistico AEC-Q100 | ||
Tempo di accesso casuale massimo 70ns | ||
Serie S29AL | ||
S29AL016J è una memoria Flash da 16 Mbit, 3,0 Volt organizzata come 2.097.152 byte o 1.048.576 parole. Il dispositivo è disponibile in contenitori BGA a 48 sfere a passo fine (passo da 0,8 mm), BGA a 64 sfere fortificate (passo da 1,0 mm) e 48pin TSOP. I dati a livello di parola (x16) vengono visualizzati su DQ15–DQ0, i dati a livello di byte (x8) vengono visualizzati su DQ7–DQ0. Questo dispositivo è progettato per essere programmato in-system con alimentazione Vcc standard da 3,0 volt. Per le operazioni di scrittura o cancellazione non sono necessari un VPP da 12,0 V o 5,0 Vcc. Il dispositivo può anche essere programmato in programmatori EPROM standard.
Il dispositivo offre un tempo di accesso di 55 ns che consente ai microprocessori ad alta velocità di funzionare senza stati di attesa. Per eliminare i conflitti sul bus, il dispositivo dispone di controlli separati di abilitazione chip (CE n.), abilitazione scrittura (N. DI PARTE) e abilitazione uscita (numero di parte).
La programmazione del dispositivo avviene eseguendo la sequenza dei comandi del programma. In questo modo viene avviato l'algoritmo Embedded Program un algoritmo interno che esegue automaticamente l'esecuzione della durata degli impulsi del programma e verifica il margine della cella corretto. La modalità di sblocco bypass facilita faster i tempi di programmazione richiedendo solo due cicli di scrittura per programmare i dati invece di quattro.
La cancellazione del dispositivo avviene eseguendo la sequenza dei comandi di cancellazione. Questo avvia l'algoritmo di cancellazione incorporato un algoritmo interno che preprogramma automaticamente l'array (se non è già programmato) prima di eseguire l'operazione di cancellazione. Durante la cancellazione, il dispositivo esegue automaticamente la cancellazione delle larghezze degli impulsi e verifica il margine della cella corretto. Il sistema host è in grado di rilevare se un'operazione di programmazione o cancellazione è completa osservando il pin RY/BY N. o leggendo i bit di stato DQ7(Data No. Polling) e DQ6 (TOGGLE). Una volta completato un ciclo di programmazione o cancellazione, il dispositivo è pronto per leggere i dati dell'array o per accettare un altro comando.
Il dispositivo offre un tempo di accesso di 55 ns che consente ai microprocessori ad alta velocità di funzionare senza stati di attesa. Per eliminare i conflitti sul bus, il dispositivo dispone di controlli separati di abilitazione chip (CE n.), abilitazione scrittura (N. DI PARTE) e abilitazione uscita (numero di parte).
La programmazione del dispositivo avviene eseguendo la sequenza dei comandi del programma. In questo modo viene avviato l'algoritmo Embedded Program un algoritmo interno che esegue automaticamente l'esecuzione della durata degli impulsi del programma e verifica il margine della cella corretto. La modalità di sblocco bypass facilita faster i tempi di programmazione richiedendo solo due cicli di scrittura per programmare i dati invece di quattro.
La cancellazione del dispositivo avviene eseguendo la sequenza dei comandi di cancellazione. Questo avvia l'algoritmo di cancellazione incorporato un algoritmo interno che preprogramma automaticamente l'array (se non è già programmato) prima di eseguire l'operazione di cancellazione. Durante la cancellazione, il dispositivo esegue automaticamente la cancellazione delle larghezze degli impulsi e verifica il margine della cella corretto. Il sistema host è in grado di rilevare se un'operazione di programmazione o cancellazione è completa osservando il pin RY/BY N. o leggendo i bit di stato DQ7(Data No. Polling) e DQ6 (TOGGLE). Una volta completato un ciclo di programmazione o cancellazione, il dispositivo è pronto per leggere i dati dell'array o per accettare un altro comando.
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